一些早期的轉換器的響應類型呈對數關系，由此來執行A-law算法或μ-law算法編碼。誤差模擬數字轉換器的誤差有若干種來源。量化錯誤和非線性誤差（假設這個模擬數字轉換器標稱具有線性特征）是任何模擬數字轉換中都存在的內在誤差。也有一種被稱作孔徑錯誤（aperture error），它是由于時鐘的不良振蕩，且常常在對時域信號數字化的過程中出現。這種誤差用一個稱為“比較低有效位”的參數來衡量。采樣率模擬信號在時域上是連續的，因此可以將它轉換為時間上連續的一系列數字信號。這樣就要求定義一個參數來表示新的數字信號采樣自模擬信號速率。這個速率稱為轉換器的采樣率或采樣頻率。使得階梯狀信號中的各個電平變為二進制碼。徐匯區本地數模轉換器性價比

轉換時間轉換時間是指A/D轉換器從轉換控制信號到來開始，到輸出端得到穩定的數字信號所經過的時間 [7]。不同類型的轉換器轉換速度相差甚遠。其中并行比較A/D轉換器的轉換速度比較高，8位二進制輸出的單片集成A/D轉換器轉換時間可達到50ns以內，逐次比較型A/D轉換器次之，它們多數轉換時間在10-50μs以內。間接A/D轉換器的速度**慢，如雙積分A/D轉換器的轉換時間大都在幾十毫秒至幾百毫秒之間。在實際應用中，應從系統數據總的位數、精度要求、輸入模擬信號的范圍以及輸入信號極性等方面綜合考慮A/D轉換器的選用 [7]。徐匯區本地數模轉換器性價比真正的電壓比較器還會增加一些輔助電路，加強性能。

轉換精度1、分辨率A/D轉換器的分辨率以輸出二進制（或十進制）數的位數來表示。它說明A/D轉換器對輸入信號的分辨能力。從理論上講，n位輸出的A/D轉換器能區分2n個不同等級的輸入模擬電壓，能區分輸入電壓的**小值為滿量程輸入的1/2n。在比較大輸入電壓一定時，輸出位數愈多，分辨率愈高。例如A/D轉換器輸出為8位二進制數，輸入信號比較大值為5V，那么這個轉換器應能區分出輸入信號的**小電壓為19.53mV [6]。2、轉換誤差轉換誤差通常是以輸出誤差的比較大值形式給出。它表示A/D轉換器實際輸出的數字量和理論上的輸出數字量之間的差別。常用比較低有效位的倍數表示。例如給出相對誤差不大于±LSB/2，這就表明實際輸出的數字量和理論上應得到的輸出數字量之間的誤差小于比較低位的半個字 [6]。

間接ADC是先將輸入模擬電壓轉換成時間或頻率，然后再把這些中間量轉換成數字量，常用的有中間量是時間的雙積分型ADC [5]。并聯比較型ADC：由于并聯比較型ADC采用各量級同時并行比較，各位輸出碼也是同時并行產生，所以轉換速度快是它的突出優點，同時轉換速度與輸出碼位的多少無關。并聯比較型ADC的缺點是成本高、功耗大。因為n位輸出的ADC，需要2n個電阻，（2n－1）個比較器和D觸發器，以及復雜的編碼網絡，其元件數量隨位數的增加，以幾何級數上升。所以這種ADC適用于要求高速、低分辯率的場合 [5]。DAC主要由數字寄存器、模擬電子開關、位權網絡、求和運算放大器和基準電壓源（或恒流源）組成。

2.主要的輸出選項是CMOS(互補金屬氧化物半導體)、LVDS(低壓差分信令)，以及CML(電流模式邏輯) [2]。3.要考慮的問題包括：功耗、瞬變、數據與時鐘的變形，以及對噪聲的抑制能力 [2]。4.對于布局的考慮也是轉換輸出選擇中的一個方面，尤其當采用LVDS技術時。 當設計者有多種ADC選擇時，他們必須考慮采用哪種類型的數字數據輸出：CMOS(互補金屬氧化物半導體)、LVDS(低壓差分信令)，還是CML(電流模式邏輯)。ADC中所采用的每種數字輸出類型都各有優缺點，設計者應結合自己的應用來考慮。這些因素取決于ADC的采樣速率與分辨率、輸出數據速率，以及系統設計的功率要求，等等 [2]。數模轉換有兩種轉換方式：并行數模轉換和串行數模轉換。黃浦區質量數模轉換器批量定制

數字信號先進行解碼，即把數字碼轉換成與之對應的電平，形成階梯狀信號，然后進行低通濾波。徐匯區本地數模轉換器性價比

實際上從數學關系來看，INL的微分結果即是DNL, DNL的積分結果即是INL 。5.單調性:單調性是指數模轉換器輸入在逐漸增加時，輸出也是逐步增加的，若輸入增加，輸出卻減小，此時即呈現非單調性，如圖4左是單調性的，圖4右是非單調性的，此時DNL會小于-1LSB6.信噪比(SNR:即信號功率比上噪聲功率(dB)，前面己經證實過，理想N位數模轉換器SNRMax=6.02N+1.76 dB，實際SNR會小于理想值。7.信噪失真比(SNDR):即信號功率比上噪聲功率加諧波功率(dB )，噪聲包含量化噪聲和干擾噪聲等等，失真則是因數模轉換器的非線性輸出一輸入關系所引起的，在頻譜上出現信號諧波。徐匯區本地數模轉換器性價比

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