為了避免混疊現(xiàn)象，模擬數(shù)字轉(zhuǎn)換器的輸入信號必須通過低通濾波器進(jìn)行濾波處理，過濾掉頻率高于采樣率一半的信號。這樣的濾波器也被稱作反鋸齒濾波器。它在實(shí)用的模擬數(shù)字轉(zhuǎn)換系統(tǒng)中十分重要，常在混有高頻信號的模擬信號的轉(zhuǎn)換過程中應(yīng)用。盡管在大多數(shù)系統(tǒng)里，混疊是不希望看到的現(xiàn)象，值得注意的是，它可以提供限制帶寬高頻信號的同步向下混合（simultaneous down-mixing ，請參見采樣過疏和混頻器）。數(shù)模轉(zhuǎn)換器的性能包含靜態(tài)性能、動態(tài)性能和瞬態(tài)性能。靜態(tài)性能包含失調(diào)誤差(offset errors)、增益誤差(gain errors)、積分非線性(Integral NonLinearity，即INL),微分非線性(Differential NonLinearity，即DNL)、以及單調(diào)性(Monotonicity);動態(tài)性能包含信噪比(SNR)、信噪失真比Signal to Noise and Distortion Ratio，即SNDR),有效位數(shù)(Effective Number of Bits)、以及總諧波失真(Total Harmonic Distortion,即THD ) ;瞬態(tài)性能包含建立時間(settling time)和毛刺能量(Cllitoh energy，D/A轉(zhuǎn)換器的轉(zhuǎn)換精度與D/A轉(zhuǎn)換器的集成芯片的結(jié)構(gòu)和接口電路配置有關(guān)。楊浦區(qū)本地數(shù)模轉(zhuǎn)換器批量定制

轉(zhuǎn)換精度1、分辨率A/D轉(zhuǎn)換器的分辨率以輸出二進(jìn)制（或十進(jìn)制）數(shù)的位數(shù)來表示。它說明A/D轉(zhuǎn)換器對輸入信號的分辨能力。從理論上講，n位輸出的A/D轉(zhuǎn)換器能區(qū)分2n個不同等級的輸入模擬電壓，能區(qū)分輸入電壓的**小值為滿量程輸入的1/2n。在比較大輸入電壓一定時，輸出位數(shù)愈多，分辨率愈高。例如A/D轉(zhuǎn)換器輸出為8位二進(jìn)制數(shù)，輸入信號比較大值為5V，那么這個轉(zhuǎn)換器應(yīng)能區(qū)分出輸入信號的**小電壓為19.53mV [6]。2、轉(zhuǎn)換誤差轉(zhuǎn)換誤差通常是以輸出誤差的比較大值形式給出。它表示A/D轉(zhuǎn)換器實(shí)際輸出的數(shù)字量和理論上的輸出數(shù)字量之間的差別。常用比較低有效位的倍數(shù)表示。例如給出相對誤差不大于±LSB/2，這就表明實(shí)際輸出的數(shù)字量和理論上應(yīng)得到的輸出數(shù)字量之間的誤差小于比較低位的半個字 [6]。閔行區(qū)質(zhì)量數(shù)模轉(zhuǎn)換器銷售廠并且把理想的輸入輸出特性的偏差與滿刻度輸出之比的百分?jǐn)?shù)定義為非線性誤差。

一些早期的轉(zhuǎn)換器的響應(yīng)類型呈對數(shù)關(guān)系，由此來執(zhí)行A-law算法或μ-law算法編碼。誤差模擬數(shù)字轉(zhuǎn)換器的誤差有若干種來源。量化錯誤和非線性誤差（假設(shè)這個模擬數(shù)字轉(zhuǎn)換器標(biāo)稱具有線性特征）是任何模擬數(shù)字轉(zhuǎn)換中都存在的內(nèi)在誤差。也有一種被稱作孔徑錯誤（aperture error），它是由于時鐘的不良振蕩，且常常在對時域信號數(shù)字化的過程中出現(xiàn)。這種誤差用一個稱為“比較低有效位”的參數(shù)來衡量。采樣率模擬信號在時域上是連續(xù)的，因此可以將它轉(zhuǎn)換為時間上連續(xù)的一系列數(shù)字信號。這樣就要求定義一個參數(shù)來表示新的數(shù)字信號采樣自模擬信號速率。這個速率稱為轉(zhuǎn)換器的采樣率或采樣頻率。

2.主要的輸出選項是CMOS(互補(bǔ)金屬氧化物半導(dǎo)體)、LVDS(低壓差分信令)，以及CML(電流模式邏輯) [2]。3.要考慮的問題包括：功耗、瞬變、數(shù)據(jù)與時鐘的變形，以及對噪聲的抑制能力 [2]。4.對于布局的考慮也是轉(zhuǎn)換輸出選擇中的一個方面，尤其當(dāng)采用LVDS技術(shù)時。 當(dāng)設(shè)計者有多種ADC選擇時，他們必須考慮采用哪種類型的數(shù)字?jǐn)?shù)據(jù)輸出：CMOS(互補(bǔ)金屬氧化物半導(dǎo)體)、LVDS(低壓差分信令)，還是CML(電流模式邏輯)。ADC中所采用的每種數(shù)字輸出類型都各有優(yōu)缺點(diǎn)，設(shè)計者應(yīng)結(jié)合自己的應(yīng)用來考慮。這些因素取決于ADC的采樣速率與分辨率、輸出數(shù)據(jù)速率，以及系統(tǒng)設(shè)計的功率要求，等等 [2]。比較器是將兩個相差不是很小的電壓進(jìn)行比較的系統(tǒng)。簡單的比較器就是運(yùn)算放大器。

間接ADC是先將輸入模擬電壓轉(zhuǎn)換成時間或頻率，然后再把這些中間量轉(zhuǎn)換成數(shù)字量，常用的有中間量是時間的雙積分型ADC [5]。并聯(lián)比較型ADC：由于并聯(lián)比較型ADC采用各量級同時并行比較，各位輸出碼也是同時并行產(chǎn)生，所以轉(zhuǎn)換速度快是它的突出優(yōu)點(diǎn)，同時轉(zhuǎn)換速度與輸出碼位的多少無關(guān)。并聯(lián)比較型ADC的缺點(diǎn)是成本高、功耗大。因?yàn)閚位輸出的ADC，需要2n個電阻，（2n－1）個比較器和D觸發(fā)器，以及復(fù)雜的編碼網(wǎng)絡(luò)，其元件數(shù)量隨位數(shù)的增加，以幾何級數(shù)上升。所以這種ADC適用于要求高速、低分辯率的場合 [5]。在轉(zhuǎn)換器電路設(shè)計中，一般要求非線性誤差不大于±1/2LSB。浦東新區(qū)質(zhì)量數(shù)模轉(zhuǎn)換器銷售廠

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DAC主要由數(shù)字寄存器、模擬電子開關(guān)、位權(quán)網(wǎng)絡(luò)、求和運(yùn)算放大器和基準(zhǔn)電壓源（或恒流源）組成。用存于數(shù)字寄存器的數(shù)字量的各位數(shù)碼，分別控制對應(yīng)位的模擬電子開關(guān)，使數(shù)碼為1的位在位權(quán)網(wǎng)絡(luò)上產(chǎn)生與其位權(quán)成正比的電流值，再由運(yùn)算放大器對各電流值求和，并轉(zhuǎn)換成電壓值 [1]。根據(jù)位權(quán)網(wǎng)絡(luò)的不同，可以構(gòu)成不同類型的DAC，如權(quán)電阻網(wǎng)絡(luò)DAC、R–2R倒T形電阻網(wǎng)絡(luò)DAC和單值電流型網(wǎng)絡(luò)DAC等。權(quán)電阻網(wǎng)絡(luò)DAC的轉(zhuǎn)換精度取決于基準(zhǔn)電壓VREF，以及模擬電子開關(guān)、運(yùn)算放大器和各權(quán)電阻值的精度。它的缺點(diǎn)是各權(quán)電阻的阻值都不相同，位數(shù)多時，其阻值相差甚遠(yuǎn)，這給保證精度帶來很大困難，特別是對于集成電路的制作很不利，因此在集成的DAC中很少單獨(dú)使用該電路 [1]。楊浦區(qū)本地數(shù)模轉(zhuǎn)換器批量定制

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