N比特電阻分壓型DAC需要2N個電阻，電流舵DAC則需要2N-1個電流單元。電阻分壓型數(shù)模轉(zhuǎn)換器利用電阻對基準(zhǔn)電壓VREF分壓產(chǎn)生1LSB的電壓，I LSB=VREF/2N，電流舵DAC由單位電流IO流過電阻負(fù)載RL產(chǎn)生的壓降IO*RL產(chǎn)生1LSB的電壓，所以電流舵DAC中的IO和位數(shù)以及RL的大小決定了VouT的幅度，VouT=(2N- I ) *RL*IO 。很明顯，圖5的兩種數(shù)模轉(zhuǎn)換器的輸出電壓特性均為單調(diào)性的。兩種數(shù)模轉(zhuǎn)換器的微分非線性誤差(DNL)均由單個器件的精度所決定，所以DNL會比較小，假設(shè)單元電流IO的標(biāo)準(zhǔn)偏差(Standard Deviation)為σ(I)，則DNL大小為σ(I)/IO，而INL和流到RL上的單元電流個數(shù)n有關(guān)，INL大小為n1/2* σ(I)/IO比較器是將兩個相差不是很小的電壓進(jìn)行比較的系統(tǒng)。簡單的比較器就是運算放大器。楊浦區(qū)優(yōu)勢數(shù)模轉(zhuǎn)換器量大從優(yōu)

轉(zhuǎn)換精度是指D/A轉(zhuǎn)換器的實際輸出與理論值之間的誤差。轉(zhuǎn)換精度可分為***精度和相對精度。(1)***精度指對應(yīng)于給定的數(shù)字量，D/A轉(zhuǎn)換器的輸出端實際測得的模擬輸出值（電流或電壓）與理論值之差。***精度由D/A轉(zhuǎn)換的增益誤差、線性誤差和噪聲等綜合因素決定。(2)相對精度指在零點和滿量程值校準(zhǔn)后，各種數(shù)字輸入的模擬量輸出與理論值之差，可把各種輸入的誤差畫成曲線。對線性D/A轉(zhuǎn)換而言，相對精度就是非線性度。 [1]精度一般采用數(shù)字量的比較低有效位作為衡量單位，一般取為± 1/2 LSB。例如，若是8位D/A轉(zhuǎn)換器，則轉(zhuǎn)換精度為±(1/2)*(1/256) = ± 1/512。浦東新區(qū)智能數(shù)模轉(zhuǎn)換器量大從優(yōu)D/A轉(zhuǎn)換器由數(shù)碼寄存器、模擬電子開關(guān)電路、解碼網(wǎng)絡(luò)、求和電路及基準(zhǔn)電壓幾部分組成。

2. 模數(shù)轉(zhuǎn)換器是將模擬信號轉(zhuǎn)換成數(shù)字信號的系統(tǒng)，是一個濾波、采樣保持和編碼的過程。模擬信號經(jīng)帶限濾波，采樣保持電路，變?yōu)殡A梯形狀信號，然后通過編碼器，使得階梯狀信號中的各個電平變?yōu)槎M(jìn)制碼。3. 比較器是將兩個相差不是很小的電壓進(jìn)行比較的系統(tǒng)。**簡單的比較器就是運算放大器。我們知道，運算放大器在連有深度負(fù)反饋的條件下，會在線性區(qū)工作，有著增益很大的放大特性，在計算時往往認(rèn)為它放大的倍數(shù)是無窮大。而在沒有反饋的條件下，運算放大器在線性區(qū)的輸入動態(tài)范圍很小，即兩個輸入電壓有一定差距就會使運算放大器達(dá)到飽和。如果同相端電壓較大，則輸出最大電壓，一般是+12V；如果反相端電壓較大，則輸出**小電壓，一般是-12V。這樣，就實現(xiàn)了電壓比較功能。

下面分別介紹每個性能參數(shù)的含義：1.失調(diào)誤差:實際數(shù)模轉(zhuǎn)換器和理想數(shù)模轉(zhuǎn)換器輸出存在固定的偏移，偏移量以LSB來表示，如圖2，失調(diào)誤差=0.3LSB 。2.增益誤差:實際數(shù)模轉(zhuǎn)換器和理想數(shù)模轉(zhuǎn)換器的輸出曲線存在增益誤差，其定義為實際數(shù)模轉(zhuǎn)換器最大電壓減去理想數(shù)模轉(zhuǎn)換器最大電壓，單位為LSB，如圖3的例子，增益誤差=0.7LSB 。3.積分非線性(INL):相同輸入數(shù)字碼時，實際數(shù)模轉(zhuǎn)換器的輸出減去其對應(yīng)的理想數(shù)模轉(zhuǎn)換器輸出，單位為LSB。4.微分非線性(DNL ):實際數(shù)模轉(zhuǎn)換器在相鄰碼遞增切換時的電壓跳變的幅度((LSB)和1LSB的差值。這個速率稱為轉(zhuǎn)換器的采樣率（samplingrate）或采樣頻率（samplingfrequency） [2]。

間接ADC是先將輸入模擬電壓轉(zhuǎn)換成時間或頻率，然后再把這些中間量轉(zhuǎn)換成數(shù)字量，常用的有中間量是時間的雙積分型ADC [5]。并聯(lián)比較型ADC：由于并聯(lián)比較型ADC采用各量級同時并行比較，各位輸出碼也是同時并行產(chǎn)生，所以轉(zhuǎn)換速度快是它的突出優(yōu)點，同時轉(zhuǎn)換速度與輸出碼位的多少無關(guān)。并聯(lián)比較型ADC的缺點是成本高、功耗大。因為n位輸出的ADC，需要2n個電阻，（2n－1）個比較器和D觸發(fā)器，以及復(fù)雜的編碼網(wǎng)絡(luò)，其元件數(shù)量隨位數(shù)的增加，以幾何級數(shù)上升。所以這種ADC適用于要求高速、低分辯率的場合 [5]。和權(quán)電阻網(wǎng)絡(luò)比較，由于它只有R、2R兩種阻值，從而克服了權(quán)電阻阻值多，且阻值差別大的缺點 [1]。松江區(qū)個性化數(shù)模轉(zhuǎn)換器銷售廠

這些因素取決于ADC的采樣速率與分辨率、輸出數(shù)據(jù)速率，以及系統(tǒng)設(shè)計的功率要求，等等 [2]。楊浦區(qū)優(yōu)勢數(shù)模轉(zhuǎn)換器量大從優(yōu)

DAC和ADC在一些處理數(shù)字信號的應(yīng)用程序中非常重要。模擬信號的可理解性或者保真性都可以得到改善，通過使用ADC將模擬的輸入信號轉(zhuǎn)換為數(shù)字的形式，然后數(shù)字信號再經(jīng)過“清理”，**終的數(shù)字脈沖再通過使用DAC重新轉(zhuǎn)換為模擬信號。數(shù)字量是由一位一位的數(shù)碼構(gòu)成的，每個數(shù)位都**一定的權(quán)。比如，二進(jìn)制數(shù)1001, 比較高位的權(quán)是23=8,此位上的代碼1表示數(shù)值1*23=8；比較低位的權(quán)是20=1，此位上的,代碼1表示數(shù)值1*20=1；其它數(shù)位均為0,因此二進(jìn)制數(shù)1001就等于十進(jìn)制數(shù)9。 [1]為了把一個數(shù)字量變?yōu)槟M量，必須把每一位的數(shù)碼按照權(quán)來轉(zhuǎn)換為對應(yīng)的模擬量，再把各模擬量相加，這樣得到的總模擬量便對應(yīng)于給定的數(shù)據(jù)。楊浦區(qū)優(yōu)勢數(shù)模轉(zhuǎn)換器量大從優(yōu)

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