根據信號與系統的理論，數字階梯狀信號可以看作理想沖激采樣信號和矩形脈沖信號的卷積，那么由卷積定理，數字信號的頻譜就是沖激采樣信號的頻譜與矩形脈沖頻譜（即Sa函數）的乘積。這樣，用Sa函數的倒數作為頻譜特性補償，由數字信號便可恢復為采樣信號。由采樣定理，采樣信號的頻譜經理想低通濾波便得到原來模擬信號的頻譜。一般實現時，不是直接依據這些原理，因為尖銳的采樣信號很難獲得，因此，這兩次濾波（Sa函數和理想低通）可以合并（級聯），并且由于這各系統的濾波特性是物理不可實現的，所以在真實的系統中只能近似完成。DAC主要由數字寄存器、模擬電子開關、位權網絡、求和運算放大器和基準電壓源（或恒流源）組成。普陀區優勢數模轉換器性價比

是基本部件。圖中裝置通過一個模擬量參考電壓和一個電阻梯形網絡產生以參考量為基準的分數值的權電流或權電壓；而用由數碼輸入量控制的一組開關決定哪一些電流或電壓相加起來形成輸出量。所謂“權”，就是二進制數的每一位所**的值。例如三位二進制數“111“,右邊第1位的“權”是 20/23=1/8；第2位是21/23=1/4；第3位是22/23=1/2。位數多的依次類推。圖2為這種三位數模轉換器的基本電路,參考電壓VREF在R1、R2、R3中產生二進制權電流,電流通過開關。青浦區加工數模轉換器推薦貨源增益誤差在消除失調誤差后用滿碼。

二進制權重圖6是5比特二進制權重的數模轉換器的實現方式，總共只有5個二進制編碼的電流單元，即后一個電流大小是前一個的兩倍，5比特二進制輸入直接控制5個開關，用以確定流到負載RL的電流大小，形成模擬電壓輸出Vout。此方式實現的數模轉換器控制非常簡單，N比特數字輸入碼直接依次加在二進制加權電流單元開關上，不需要任何的譯碼動作。為了達到比較好的版圖匹配，n*IO電流單元由n個單獨的IO單元來實現。二進制加權數模轉換器的缺點就是DNL 比較差，理論上來講，**差的DNL發生在MSB(Most significant Bit)的轉換:

輸入時其輸出值與理想輸出值(滿量程)之間的偏差表示，一般也用LSB的份數或用偏差值相對滿量程的百分數來表示。非線性誤差D/A轉換器的非線性誤差定義為實際轉換特性曲線與理想特性曲線之間的比較大偏差，并以該偏差相對于滿量程的百分數度量。在轉換器電路設計中，一般要求非線性誤差不大于±1/2LSB。并行數模轉換數模轉換有兩種轉換方式：并行數模轉換和串行數模轉換。圖1為典型的并行數模轉換器的結構。虛線框內的數碼操作開關和電阻網絡是基本部件。數模轉換器電路還用在利用反饋技術的模數轉換器設計中。

數字量是用代碼按數位組合起來表示的，對于有權碼，每位代碼都有一定的位權。為了將數字量轉換成模擬量，必須將每1位的代碼按其位權的大小轉換成相應的模擬量，然后將這些模擬量相加，即可得到與數字量成正比的總模擬量，從而實現了數字—模擬轉換。這就是組成D/A轉換器的基本指導思想。圖11.1.1表示了4位二進制數字量與經過D/A轉換后輸出的電壓模擬量之間的對應關系。 由圖11.1.1還可看出，兩個相鄰數碼轉換出的電壓值是不連續的，兩者的電壓差由比較低碼位**的位權值決定。它是信息所能分辨的**小量，也就是我們所說的用1LSB(Least Significant Bit)表示。對應于比較大輸入數字量的最大電壓輸出值（***值），用FSR(Full Scale Range)表示和權電阻網絡比較，由于它只有R、2R兩種阻值，從而克服了權電阻阻值多，且阻值差別大的缺點 [1]。金山區加工數模轉換器怎么樣

失調誤差(或稱零點誤差)定義為數字輸入全為0碼時，其模擬輸出值與理想輸出值之偏差值。普陀區優勢數模轉換器性價比

轉換時間轉換時間是指A/D轉換器從轉換控制信號到來開始，到輸出端得到穩定的數字信號所經過的時間 [7]。不同類型的轉換器轉換速度相差甚遠。其中并行比較A/D轉換器的轉換速度比較高，8位二進制輸出的單片集成A/D轉換器轉換時間可達到50ns以內，逐次比較型A/D轉換器次之，它們多數轉換時間在10-50μs以內。間接A/D轉換器的速度**慢，如雙積分A/D轉換器的轉換時間大都在幾十毫秒至幾百毫秒之間。在實際應用中，應從系統數據總的位數、精度要求、輸入模擬信號的范圍以及輸入信號極性等方面綜合考慮A/D轉換器的選用 [7]。普陀區優勢數模轉換器性價比

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