混疊所有的模擬數字轉換器以每隔一定時間進行采樣的形式進行工作。因此,它們的輸出信號只是對輸入信號行為的不完全描述。在某一次采樣和下一次采樣之間的時間段,**根據輸出信號,是無法得知輸入信號的形式的。如果輸入信號以比采樣率低的速率變化,那么可以假定這兩次采樣之間的信號介于這兩次采樣得到的信號值。然而,如果輸入信號改變過快,則這樣的假設是錯誤的。如果模擬數字轉換器產生的信號在系統的后期,通過數字模擬轉換器,則輸出信號可以忠實地反映原始信號。如經過輸入信號的變化率比采樣率大得多,則是另一種情況,模擬數字轉換器輸出的這種“假”信號被稱作“混疊”。混疊信號的頻率為信號頻率和采樣率的差。例如,一個2千赫茲的正弦曲線信號在采樣率在1.5千赫茲采樣率的轉換后,會被重建為500赫茲的正弦曲線信號。這樣的問題被稱作“混疊”。偏差值的大小一般用LSB的份數或用偏差值相對滿量程的百分數來表示。閔行區智能數模轉換器私人定做

分辨率分辨率是指D/A轉換器能夠轉換的二進制位數。位數越多,分辨率越高。對一個分辨率為n位的D/A轉換器,能夠分辨的輸入信號為滿量程的1/2n。 [1]例如:8位的D/A轉換器,若電壓滿量程為5V,則能分辨的**小電壓為5V/28≈20mV, 10位的D/A轉換器,若電壓滿量程為5V,則能分辨的**小電壓為5V/210≈5mV。轉換時間圖5-2轉換時間是指D/A轉換器由數字量輸入到轉換輸出穩定為止所需的時間。轉換時間也叫隱定時間或者建立時間。當輸出的模擬量為電壓時,建立時間較長,主要是輸出運算放大器所需的時間。圖5-2中所示的ts即為轉換時間。嘉定區質量數模轉換器銷售廠可以采集連續變化、帶寬受限的信號,然后可以通過插值將轉換后的離散信號還原為原始信號。

輸入時其輸出值與理想輸出值(滿量程)之間的偏差表示,一般也用LSB的份數或用偏差值相對滿量程的百分數來表示。非線性誤差D/A轉換器的非線性誤差定義為實際轉換特性曲線與理想特性曲線之間的比較大偏差,并以該偏差相對于滿量程的百分數度量。在轉換器電路設計中,一般要求非線性誤差不大于±1/2LSB。并行數模轉換數模轉換有兩種轉換方式:并行數模轉換和串行數模轉換。圖1為典型的并行數模轉換器的結構。虛線框內的數碼操作開關和電阻網絡是基本部件。
DAC主要由數字寄存器、模擬電子開關、位權網絡、求和運算放大器和基準電壓源(或恒流源)組成。用存于數字寄存器的數字量的各位數碼,分別控制對應位的模擬電子開關,使數碼為1的位在位權網絡上產生與其位權成正比的電流值,再由運算放大器對各電流值求和,并轉換成電壓值 [1]。根據位權網絡的不同,可以構成不同類型的DAC,如權電阻網絡DAC、R–2R倒T形電阻網絡DAC和單值電流型網絡DAC等。權電阻網絡DAC的轉換精度取決于基準電壓VREF,以及模擬電子開關、運算放大器和各權電阻值的精度。它的缺點是各權電阻的阻值都不相同,位數多時,其阻值相差甚遠,這給保證精度帶來很大困難,特別是對于集成電路的制作很不利,因此在集成的DAC中很少單獨使用該電路 [1]。一般情況下,影響D/A轉換精度的主要環境和工作條件因素是溫度和電源電壓變化。

D/A轉換器由數碼寄存器、模擬電子開關電路、解碼網絡、求和電路及基準電壓幾部分組成。數字量以串行或并行方式輸入、存儲于數碼寄存器中,數字寄存器輸出的各位數碼,分別控制對應位的模擬電子開關,使數碼為1的位在位權網絡上產生與其權值成正比的電流值,再由求和電路將各種權值相加,即得到數字量對應的模擬量。按解碼網絡結構不同T型電阻網絡D/A轉換器相關示圖倒T型電阻網絡D/A轉換器權電流D/A轉換器權電阻網絡D/A轉換器按模擬電子開關電路的不同CMOS開關型D/A轉換器(速度要求不高)雙極型開關D/A轉換器 電流開關型(速度要求較高)ECL電流開關型(轉換速度更高)對于雙極性D/A轉換,理想值為負域滿量程。長寧區本地數模轉換器銷售廠
ADC中所采用的每種數字輸出類型都各有優缺點,設計者應結合自己的應用來考慮。閔行區智能數模轉換器私人定做
由于實際使用的模擬數字轉換器不能進行完全實時的轉換,所以對輸入信號進行一次轉換的過程中必須通過一些外加方法使之保持恒定。常用的有采樣-保持電路,在大多數的情況里,通過使用一個電容器可以存儲輸入的模擬電壓,并通過開關或門電路來閉合、斷開這個電容和輸入信號的連接。許多模擬數字轉換集成電路在內部就已經包含了這樣的采樣-保持子系統 [2]。1.**儀表促進了更快的ADC速度和更多的通道數與密度,設計者必須評估轉換器的輸出格式,以及基本的轉換性能 [2]。閔行區智能數模轉換器私人定做
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